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AI驱动的设计应用
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用于 5G 移动基础架构的 DesignWare IP
随着 5G 移动技术中数据流量的不断增长，对移动基础架构的需求也在不断增加。不断增长的移动带宽需求、更多的物联网连接和先进的自动驾驶技术以及支持实时交互系统的新兴技术，需要各种高带宽 IP 解决方案来满足这些需求。
Synopsys 为业界提供非常广泛的接口 IP、数据转换器 IP、安全 IP 和各种处理器解决方案组合，可提供 5G 基础架构应用所需的容量和性能。
悬停或点击鼠标以了解有关 DesignWare IP 解决方案的更多信息：
DDR
- 支持 JEDEC DDR5 & DDR4 标准 SDRAM 和 DIMM
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以太网
- 支持 10/100/1G 至 100G 的 MAC、PCS 和 PHY
- 积极推进实现 TSN 和 25G/50G/100G 企业版解决方案。
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高速 SerDes
- 优质的信号完整性和先进的电源管理功能，适用于 PCIe、CCIX、JESD204、以太网、CPRI 等
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ARC EV6x 处理器
- 配备 ISA，优化了通信算法和机器学习性能的宽 SIMD/VLIW 处理器
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安全 / HSM
- 硬件安全模块是移动芯片组的标准组件，因为嵌入式/集成 SIM 功能已成为未来趋势。
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5G NR UE 处理
- ASIP 工具 — 行业领先的基带处理器开发工具。使用硬件并行性和自定义数据路径部署任务优化的处理解决方案，同时保持可编程性。非常适合自定义应用优化
- ARC HSxD — 结合 CPU+DSP 架构和多核控制操作；高效连接硬件加速器
- ARC EV6x — 配备 ISA，优化了通信算法和机器学习性能的宽 SIMD/VLIW 处理器
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PCIe 控制器和 PHY
- 支持 PCIe 4.0、3.1、2.1、1.1 的高性能、多通道 PCIe PHY
- 支持 PCIe 4.0、3.1、2.1、1.1 的可配置 PCIe 控制器
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模拟前端
- 通过数百种实现，提供千兆赫信道带宽、高 QAM、低 BOM 成本、直接射频转换
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模拟前端
- 通过数百种实现，提供千兆赫信道带宽、高 QAM、低 BOM 成本、直接射频转换
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- 模拟前端通过数百种实现，提供千兆赫信道带宽、高 QAM、低 BOM 成本、直接射频转换
- ASIP Designer 部署具有硬件并行性和自定义数据路径的任务优化处理解决方案，同时保留 5G 基带处理的可编程性
- ARC HS4xD 结合 CPU+DSP 架构和多核控制操作，同时高效连接硬件加速器
- ARC VPX是带有ISA优化的大位宽SIMD/VLIW 处理器助力通信算法和机器学习
- 安全协议加速器支持获得区域批准的密码、散列和 MAC 算法，为新一代 5G SoC 提供灵活的解决方案。 真随机数生成器 以及其他加密芯核能够支持设计人员构建自己的解决方案。
- 支持全新的 DDR5/4 标准
- 以太网 MAC、PCS 和 PHY 支持 10/100/1G 至 100G。积极推进实现 TSN 和 25G/50G/100G 企业版解决方案
- 多协议高速 SerDes PHY 为 PCIe、CCIX、JESD204、以太网、CPRI 等提供优质的信号完整性和高级电源管理功能